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辽宁工程技术大学电子技术课程设计
1. 设计的任务与要求
显示两位的天数倒计时，如99到1
a) 当到9时喇叭自动响0时结束
b) 用LED数码管显示结果
c) 可以实现预置数功能
2. 方案设计与分析
2.1 方案的比较与选择
方案一：通过减法器实现两位数是十进制数减法运算，实现倒数功能，并通过译码器和LED
数码管驱动电路。
方案二：通过秒表计时器，以及计数器连接成的一天为单位的计时器，接入减法器，实现
倒数功能，并通过CD4511接在译码显示器，实现倒计数功能。
比较分析：两种方案相比较，虽然方案二的计数步骤比较多，并且逻辑性可能稍强，并且
通过上网查资料，和图书馆的查阅，对陌生的元器件不是很了解，并且接触很少。
因此，
通过比较实用性，合理性，选择方案一。
方案二逻辑框图
计时器电
路；
→ →
09~01时喇叭响
信号源电
十进制加法
路
器电路
↓
同步减法
器
↓
译码显示电
路
2.2 实验方案：
用555多谐振荡器产生脉冲，两个传输门进行控制两个计数器的触发脉冲，传输门由
两个计数器的置位端（LD）控制，当置数时触发脉冲被隔断，用74LS160控制置位端的A，
B，C，D门一个脉冲开关控制此计数器的触发端CLK，当按下开关松开时，输出（置位的
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赵佳鑫：考试天数倒计时器的设计
数）加1.用数码管显示减法计数器的输出，用一个四输入与非门作为反馈，当天数小于9
时蜂鸣器响。
3. 原理及技术指标
3.1 实验原理
：
我们可以用555时基电路构成的多谐振荡器来产生频率为10Hz的脉冲，即输出周期
为0.1秒的方波脉冲，将该方波脉冲信号送到计数器74LS190的CP减计数脉冲端,再通过
译码器74LS160把输入的8421BCD码经过内部作和电路“翻译”成七段（a，b，c，d，e，
f，g）输出，显示十进制数，或者将该方波脉冲信号送到减法计数器CD的CP减计
数脉冲端,通过计数器把8421BCD码经过内部作和电路“翻译”成七段（a，b，c，d，e，
f，g）输出，显示十进制数将该方波脉冲信号送到减法计数器CD的CP减计数脉冲
端,通过计数器把8421BCD码经过内部作和电路“翻译”成七段（a，b，c，d，e，f，g）
输出，显示十进制数，然然后在适当的位置设置开关或控制电路即可实现计数器的直接清
零，启动和暂停连续、译码显示电路的显示。
3.2 实验设备
：
实验所需要的设备。
74LS160，2个开关，1个脉冲开关，1个1K电阻，1个1.49K电
阻，1个10
?
F
电容，1个0.01
?
F
电容，2个74LS190，74LS48四输入与非门，LM555CM，
2个七段译码器，一个蜂鸣器，2个LED显示器。
4. 单元电路设计及参数计算
4.1单元电路设计：
4.1.1计数器电路
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辽宁工程技术大学电子技术课程设计
4.1.2 脉冲发生电路
（1）555定时器
555定时器是一种模拟和数字功能相结合的中规模集成器件。
一般用双极性工艺制作
的称为 555，用 CMOS 工艺制作的称为 7555，除单定时器外，还有对应的双定时器
。
555 定时器的电源电压范围宽，可在 4.5V~16V 工作，7555 可在 3~18V 工作，
输出驱动电流约为 200mA，因而其输出可与 TTL、CMOS 或者模拟电路电平兼容。
它的各个引脚功能如下：1脚：外接电源负端VSS或接地，一般情况下接地。
8脚：外接
电源VCC，双极型时基电路VCC的范围是4.5 ~ 16V，CMOS型时基电路VCC的范围为3 ~ 18V。
一般用5V。
3脚：输出端Vo。
2脚：低触发端。
6脚：TH高触发端。
4脚：是直接清零端。
当此端接低电平，则时基电路不工作，此时不论TR、TH处于何电平，时基电路输出为“0”，
该端不用时应接高电平。
5脚：VC为控制电压端。
若此端外接电压，则可改变内部两个比
较器的基准电压，当该端不用时，应将该端串入一只0.01μF电容接地，以防引入干扰。
7脚：放电端。
该端与放电管集电极相连，用做定时器时电容的放电。
在1脚接地，5脚
未外接电压，两个比较器A1、A2基准电压分别为的情况下，555时基电路的功能表如表所
示。
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显示十进制数
若此端外接电压
若此端外接电压
5脚未外接电压
g）输出
因而其输出可与 TTL
3.2 实验设备： 实验所需要的设备
可在 4.5V~16V 工作
555 定时器的电源电压范围宽
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